ECP3 FPGA系列:AMC评估开发方案

Lattice公司的LatticeECP3 FPGA系列可提供高性能特性如增强的DSP架构，高速SERDES和高速源同步接口。LatticeECP3采用65nm技术，查找表(LUT)高达149k逻辑单元，支持高达486个用户I/O，提供高达320个18×18乘法器和各种并行I/O标准，主要用于对成本和功耗敏感的无线基础设备和有线通信。

FPGA器件的LatticeECP3系列经过优化来提供高器件的性能，如增强的DSP架构，高速SERDES，和经济型FPGA架构，高速源同步接口。这种组合是通过器件架构的进步，和65nm技术的使用而完成的，这就使得其设备适合高容量、高速度和低成本的要求。 LatticeECP3器件系列使得查找表（LUT）的容量扩大至149k逻辑单元，并支持多达486个用户I/ O。

LatticeECP3器件系列还提供了多达320个18×18乘法器和广泛的并行I/O标准。LatticeECP3 FPGA架构进行了优化，目的是提高性能和降低成本。LatticeECP3器件采用可重构SRAM逻辑技术，并提供了深受欢迎的构件，如基于LUT的逻辑，分布式的嵌入式存储器，锁相环（PLL），延迟锁定环（DLL），预制的源同步I-/ O支持，增强的sysDSP片以及先进的配置支持，包括加密和双启动功能。

在LatticeECP3系列上应用的、预设计的源同步逻辑支持广泛的接口标准，包括DDR3，XGMII和7:1 LVDS。 LatticeECP3器件系列还具有专门用于PC功能的高速SERDES。高抖动容限和低传输抖动使得SERDES+PCS块可以进行配置，以支持流行的数据协议，包括PCI Express，SMPTE，以太网（XAUI，千兆以太网和SGMII）和CPRI。发送预加重和接收均衡设置使得SERDES非常合适各种形式的媒体传输和接收。

LatticeECP3器件还提供灵活，可靠和安全的配置选项，如双启动，比特流加密和TransFR现场升级功能。Lattice的ispLEVER设计工具套件，通过使用LatticeECP3 FPGA系列，可以使得大型复杂的设计更加有效地实施。支持LatticeECP3的综合资料库可以提供给工程师，以便逻辑综合工具的使用。

ispLEVER工具采用了结合型工具输出（避免板上平面图设计工具的制约）来设计LatticeECP3器件的路线和布局。ispLEVER工具从路由中提取时序，并诠释成设计，用以验证时序。Lattice公司为LatticeECP3系列提供了许多预先设计的IP（知识产权） ispLeverCORE模块。采用这些可配置的软核IP作为标准化的模块，设计师们可以没有后顾之忧地专注于他们的独特设计，以增加效率。
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